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この求人情報は、人材紹介会社である「合同会社未来共創」が取り扱っています。
- 正社員
- 未経験者歓迎
- 第二新卒・既卒者可
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- 年間休日120日以上
- 語学力を活かせる
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会社名非公開
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募集要項
仕事詳細
《回路設計デザイナー》
1）コモディティDRAM設計（JEDEC規格に基づく）
2）その他のメモリ製品（カスタムDRAM、フラッシュ、SRAM）
3）ファウンドリのIP設計（I / F-Phy、IBISモデルなど）
《レイアウトデザイナー》
1）メモリ製品のレイアウト設計
2）自動P＆R設計方法
《検証エンジニア》
・メモリ製品の論理検証
・RTL設計方法論
・セルライブラリの特性評価
・完全なカスタムデザインフローミックスシグナルシミュレーションの経験があれば尚可。
・マルチパワードメイン分析の経験があれば尚可
《EDAエンジニア/インフラ管理者》
1）Linuxサーバーシステムの管理者
2）設計環境のEDAサポート
3）シミュレーションに精通している
1）コモディティDRAM設計（JEDEC規格に基づく）
2）その他のメモリ製品（カスタムDRAM、フラッシュ、SRAM）
3）ファウンドリのIP設計（I / F-Phy、IBISモデルなど）
《レイアウトデザイナー》
1）メモリ製品のレイアウト設計
2）自動P＆R設計方法
《検証エンジニア》
・メモリ製品の論理検証
・RTL設計方法論
・セルライブラリの特性評価
・完全なカスタムデザインフローミックスシグナルシミュレーションの経験があれば尚可。
・マルチパワードメイン分析の経験があれば尚可
《EDAエンジニア/インフラ管理者》
1）Linuxサーバーシステムの管理者
2）設計環境のEDAサポート
3）シミュレーションに精通している
職種
デジタル回路設計・開発、研究・設計・開発系その他
雇用形態
正社員
勤務地（住所）
横浜/福岡
給与・年収
8,000,000円 〜 20,000,000円
待遇・福利厚生
年給open！（現収30%以上UP）
全て、日本式の福祉厚生！
全て、日本式の福祉厚生！
休日・休暇
日本式の休日
求人更新日
2024年2月5日
求人の募集元企業
会社名
会社名非公開
事業内容
中国国内本社に約70名程度の外国人技術者が在職、日本人、韓国人多数。
日本拠点が2020年に創設し、新横浜と福岡。
日本拠点が2020年に創設し、新横浜と福岡。
その他・PR
- わたくしから
- 皆様の将来不安を払拭出来るよう寄り添って参ります。
ご希望とマッチする企業様ご案内します。
また履歴書＆職務経歴書の添削・レイアウト、
採用担当者に好印象を持って頂けるノウハウや面接対策等もお教えします。
その他類似した案件も併せてご紹介して参ります。
応募方法
応募資格
《回路設計デザイナー》
1）電子機器関連の基本知識
2）Cadence virtuosoのschematic editor
3）スパイスシミュレーター（HSPICE、Spectreなど）
4）Verilog-HDL
5）基本的なDRAM技術の認識
《レイアウトデザイナー》
1）電子機器関連の基本知識
2）Cadence virtuosoのschematic editor
3）自動P＆Rの基本的認識
4）Calibre DRC / LVS検証
5）Star-RC/QRC extraction for parasitic extractionESD design
《検証エンジニア》
1）Verilog-HDL / VHDL言語
2）検証環境の構築
3）SV（システムVerilog）; UVM利用可能であれば尚可
4）デジタルシミュレータ（NC、VCSなど）。 STAツール利用可能であれば尚可
5）基本デバイス（ゲート、p / nmos、キャップ、抵抗など）のデジタル特性（ドライバ強度、IO方向など）
6）SDF
《EDAエンジニア/インフラ管理者》
1）Window / LinuxOSの基本認識
2）ケイデンススキルプログラム
3）NIS / NIFシステムの基本認識
4）テキスト処理プログラム（Perl、awkなど）
5）ITサポートチームおよびCADチームと通信（良い英語または中国語）
6）リモートサイト間のデータ管理の経験
1）電子機器関連の基本知識
2）Cadence virtuosoのschematic editor
3）スパイスシミュレーター（HSPICE、Spectreなど）
4）Verilog-HDL
5）基本的なDRAM技術の認識
《レイアウトデザイナー》
1）電子機器関連の基本知識
2）Cadence virtuosoのschematic editor
3）自動P＆Rの基本的認識
4）Calibre DRC / LVS検証
5）Star-RC/QRC extraction for parasitic extractionESD design
《検証エンジニア》
1）Verilog-HDL / VHDL言語
2）検証環境の構築
3）SV（システムVerilog）; UVM利用可能であれば尚可
4）デジタルシミュレータ（NC、VCSなど）。 STAツール利用可能であれば尚可
5）基本デバイス（ゲート、p / nmos、キャップ、抵抗など）のデジタル特性（ドライバ強度、IO方向など）
6）SDF
《EDAエンジニア/インフラ管理者》
1）Window / LinuxOSの基本認識
2）ケイデンススキルプログラム
3）NIS / NIFシステムの基本認識
4）テキスト処理プログラム（Perl、awkなど）
5）ITサポートチームおよびCADチームと通信（良い英語または中国語）
6）リモートサイト間のデータ管理の経験
お仕事探しアドバイス
- この求人のような半導体・電気・電子部品業界への転職を考えているユーザーの情報まとめ
- キャリアインデックスに登録をしているユーザーの中で、半導体・電気・電子部品業界希望のユーザーは、現在の年収が平均:731万円です。男女比は男性・92%：女性・8%で、平均年齢は56歳です。これまでに平均2回ほどの転職を経験しており、現在は離職中の人が45%・就業中の人が55%です。また、この業界には、英語スキルが中級（日常会話可）レベルで応募可能な職種の求人もあります。半導体・電気・電子部品業界の求人にご応募される際は是非ともご参考にしてください。
