半導体設計・開発、コンサルティング、退職金制度ありの転職・求人検索結果
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- 正社員
- 第二新卒・既卒者可
- 学歴不問
- 転勤なし
- フレックスタイム制
- 年間休日120日以上
- 土日祝日休み
- 完全週休2日制
- 退職金制度あり
株式会社エッチ・ディー・ラボ
【新横浜】<ハイクラス>RTL論理設計職〜転居伴う転勤なし/完全週休2日制/リモートワーク可〜【エージェントサービス求人】
【新横浜】<ハイクラス>RTL論理設計職〜転居伴う転勤なし/完全週休2日制/リモートワーク可〜
〜大手電子総合企業にて最先端の技術に携われます/技術者としてスキルアップが可能です/ご希望の勤務地を考慮してアサインします〜
■業務内容:
電子総合システム企業にて、LSI/ASI…-
<予定年収>
600万円〜800万円
<賃金形態>
月給制
月により所定工数が変わっても定額月給を支給。時間外労働は法定通りに割増賃金を支給。
<賃金内訳>
月額(基本給):410,000円〜450,000円
その他固定手当/月:40,000円
<月給>
450,000円〜490,000円
<昇給有無>
有
<残業手当>
有
<給与補足>
※詳細は面接内でご質問ください。
■昇給... -
<勤務地詳細>
本社
住所:神奈川県横浜市港北区新横浜3-18-14 住生新横浜第2ビル4F
勤務地最寄駅:各線/新横浜駅
受動喫煙対策:屋内喫煙可能場所あり -
学歴不問
<応募資格/応募条件>
■必須条件:
LSI設計/ASIC設計/SOC設計/FPGA設計の経験、RTL論理設計・検証を直近に2年以上実務経験がある方
Verilog-HDLあるいはVHDLの設計経験がある方
■歓迎条件:
ファームウエア設計、C言語、Python等の経験がある方
<年齢制限>
60歳未満
定年年齢を上限とした募集のため
情報提供元:
-
- 正社員
- 第二新卒・既卒者可
- 学歴不問
- 転勤なし
- 年間休日120日以上
- 土日祝日休み
- 残業少なめ
- 完全週休2日制
- 退職金制度あり
株式会社エッチ・ディー・ラボ
【新横浜】回路設計エンジニア(半導体)〜転勤無/回路設計の総合コンサルティング会社/残業30h未満〜【エージェントサービス求人】
【新横浜】回路設計エンジニア(半導体)〜転勤無/回路設計の総合コンサルティング会社/残業30h未満〜
〜回路設計の総合コンサルティング会社/完全週休二日/年間休日124日/転勤無/残業30h未満〜
■業務内容:通信、画像処理に関するHDL設計、LSI・FPGA設計、コンサルテ…-
<予定年収>
500万円〜720万円
<賃金形態>
月給制
<賃金内訳>
月額(基本給):310,000円〜380,000円
その他固定手当/月:40,000円
<月給>
350,000円〜420,000円
<昇給有無>
有
<残業手当>
無
<給与補足>
※詳細は面接内でご質問ください。
■昇給:年1回(4月)
■賞与:年2回(6月・12月)※支給実績6ヶ月分
■業績賞与:年1... -
<勤務地詳細>
本社
住所:神奈川県横浜市港北区新横浜3-17-6 イノテックビル10F
勤務地最寄駅:各線/新横浜駅
受動喫煙対策:屋内全面禁煙 -
学歴不問
<応募資格/応募条件>
■必須条件:
・HDL(Verilog HDL、VHDL)での電子回路設計経験をお持ちの方
※経験工程/プロジェクト規模は不問です。
※デジタル/アナログ、FPGA/ASICは不問です。
情報提供元:
-
- 正社員
- 第二新卒・既卒者可
- 学歴不問
- 転勤なし
- フレックスタイム制
- 年間休日120日以上
- 土日祝日休み
- 完全週休2日制
- 退職金制度あり
株式会社エッチ・ディー・ラボ
【新横浜】RTL論理設計職〜転居伴う転勤なし/完全週休2日制/リモートワーク可〜【エージェントサービス求人】
【新横浜】RTL論理設計職〜転居伴う転勤なし/完全週休2日制/リモートワーク可〜
〜大手電子総合企業にて最先端の技術に携われます/技術者としてスキルアップが可能です/ご希望の勤務地を考慮してアサインします〜
■業務内容:
電子総合システム企業にて、LSI/ASIC/SOC/F…-
<予定年収>
500万円〜800万円
<賃金形態>
月給制
月により所定工数が変わっても定額月給を支給。時間外労働は法定通りに割増賃金を支給。
<賃金内訳>
月額(基本給):310,000円〜450,000円
その他固定手当/月:40,000円
<月給>
350,000円〜490,000円
<昇給有無>
有
<残業手当>
有
<給与補足>
※詳細は面接内でご質問ください。
■昇給... -
<勤務地詳細>
本社
住所:神奈川県横浜市港北区新横浜3-18-14 住生新横浜第2ビル4F
勤務地最寄駅:各線/新横浜駅
受動喫煙対策:屋内喫煙可能場所あり -
学歴不問
<応募資格/応募条件>
■必須条件:
LSI設計/ASIC設計/SOC設計/FPGA設計の経験、RTL論理設計・検証を直近に2年以上実務経験がある方
Verilog-HDLあるいはVHDLの設計経験がある方
■歓迎条件:
ファームウエア設計、C言語、Python等の経験がある方
情報提供元:
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