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この求人情報は、人材紹介会社である「株式会社ワークポート」が取り扱っています。

  • 正社員
  • 学歴不問
  • フレックスタイム制
  • 年間休日120日以上
  • 土日祝日休み
  • 残業少なめ
  • 始業10時以降

株式会社エッチ・ディー・ラボ

【神奈川】半導体設計エンジニア

情報提供元:イーキャリアFA

求人更新日:2024年4月25日

募集要項

仕事詳細
【職務概要】
半導体設計エンジニアを担当していただきます。

【職務詳細】
VHDL、Verilog-HDL、System Verilog、SystemCによる、
ロジック回路設計を主にお任せします。
ハイレベルな設計を手がけていただくことが多くなります。

また、SystemCに関する技術提供、新たな設計環境構築、設計を
効率化するための手法を開発する設計・検証コンサルティングに
携わっていただくことも可能です。

ロジック回路設計からスタートするもよし、
最初からコンサルティングに携わるもよし。
あなたの希望と実力に応じて、選択していただけます。

【ハイレベルな設計に携われるワケ】
トレーニング、講演会などを通じて、多くの大手半導体メーカーや
機器メーカーに技術提供する同社。これらの実績が高く評価され、
設計も手がけてほしいというオファーが絶えませんでした。
そこで、実際に設計も行なうように。代表取締役の実績から、
抽象度の高いハイレベルな設計をお願いされることが多くあります。
職種
アナログ回路設計・開発、デジタル回路設計・開発
雇用形態
正社員
勤務地(都道府県)
神奈川県
勤務地(住所)
【関東】神奈川県 横浜市港北区
JR・地下鉄各線「新横浜」駅徒歩7分
給与・年収
4,500,000円 〜 6,500,000円
待遇・福利厚生
年収:450万~850万

 ■月給制:月額320000円
 ■給与:■経験、スキル、年齢を考慮の上、同社規定により優遇
 ■賞与:2回
 ■昇給:1回
 ■雇用形態:正社員
 ■試用期間補足:3ヵ月
 ■待遇■
 交通費全額支給、出張手当、海外研修制度、退職金制度、社員持株制度、保養所

 ■勤務時間:フレックスタイム制(標準労働時間7時間)
※コアタイム10時00分~15時00分
 ■休憩:60分
 ■喫煙情報:屋内禁煙
休日・休暇
年間休日128日、完全週休2日制(土・日)、祝日、夏季、年末年始、有給(初年度12日)、慶弔、代休
求人更新日
2024年4月25日

求人の募集元企業

会社名
株式会社エッチ・ディー・ラボ
設立日
1996年4月
資本金
3,780万円
事業内容
【事業内容】・通信、画像処理に関するHDL設計、LSI・FPGA設計、コンサルティング・IP開発、LSI・FPGA設計トレーニング

【会社の特徴】《 半導体業界の設計基準を開発した同社 》
同社は回路設計の総合コンサルティング会社です。そして、半導体業界の設計基準である『RTLデザイン・スタイルガイド』を開発した企業でもあります。さらに、多くのメーカーが自社のエンジニアに、同社の研修を受けさせています。この理由は、15年前に同社の代表である長谷川さんが著した『デザインスタイルガイド』という電子回路設計についての書籍にあります。今では日本国内の電子回路設計における基準として扱われており、その著者をはじめとした講師が教鞭をふるうため、多数の大手メーカーが頼っているのです。このような20年以上前から築いてきた実績を活かし、日本を代表する大手半導体、電子機器メーカーと肩を並べて研究開発を手がけているのが同社です。

その他・PR

【選考プロセス】
書類選考→面接1回~2回→内定

応募方法

応募資格
【必須】
・VHDL、Verilog-HDLによるロジック回路設計の経験

【尚可】
・SystemCへの興味

《毎月1回は勉強会を実施》
技術ノウハウの共有を目的として、全員で勉強会を行なっています。
現在は、SystemCの設計手法に関する勉強会が主流です。
講師役となるのはメンバー全員。順番を決め、当番制で行なっています。

《社外セミナーへの参加を奨励》
他社が主催する技術トレーニングなどのセミナーへの参加を奨励しています。
また、海外研修に参加する機会も用意しています。

この求人を取り扱う人材紹介会社の情報

株式会社ワークポート

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株式会社ワークポート

必読

この求人情報は、人材紹介会社である「株式会社ワークポート」が取り扱っています。
この求人に応募すると、応募情報がイーキャリアFA経由で移送され、株式会社ワークポートに登録されます。
その後、株式会社ワークポートからの連絡があり、応募完了となります。

求人更新日:2024年4月25日

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