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株式会社ヘルツテック
LSI電子回路設計エンジニア
【ハードウェア設計エンジニア】大手メーカー中心!経験や希望に沿ったものづくりに集中できる環境があります!
【ハードウェア設計エンジニア】大手メーカー中心!経験や希望に沿ったものづくりに集中できる環境があります!
情報提供元:
求人更新日:2023年7月3日
募集要項
仕事詳細
カーエレクトロニクスのイーメジセンサーLSI設計開発をご担当いただきます。
◎システムLSIの設計・開発(フロントクエンド)
【プロジェクト例】
大手メーカーのイーメジセンサーLSI設計開発案件。
多くのプロジェクトは10~50名規模で、多ければ100名規模となります。※LSIに携わっている案件は300名規模の場合もございます。
【仕事の魅力】
・代表・役員が元々エンジニアであるため、ものづくりに対する情熱を大事にしています。
・大手企業が取引先となっており、プロジェクト規模にもよりますが、直取引もございます。
・要件定義や仕様書作成ができるレベルからマネージャーレベルまでの業務まで幅広い選択肢があります。
・年齢・職種の幅が広い仕事があり、現場で働き続けたいという意欲を尊重します!また、今後は請負開発案件にも力を入れ、社内で開発が行える体制をつくっていきたいと考えています。
◎システムLSIの設計・開発(フロントクエンド)
【プロジェクト例】
大手メーカーのイーメジセンサーLSI設計開発案件。
多くのプロジェクトは10~50名規模で、多ければ100名規模となります。※LSIに携わっている案件は300名規模の場合もございます。
【仕事の魅力】
・代表・役員が元々エンジニアであるため、ものづくりに対する情熱を大事にしています。
・大手企業が取引先となっており、プロジェクト規模にもよりますが、直取引もございます。
・要件定義や仕様書作成ができるレベルからマネージャーレベルまでの業務まで幅広い選択肢があります。
・年齢・職種の幅が広い仕事があり、現場で働き続けたいという意欲を尊重します!また、今後は請負開発案件にも力を入れ、社内で開発が行える体制をつくっていきたいと考えています。
職種
研究・設計・開発系その他
雇用形態
正社員
勤務地(都道府県)
神奈川県
勤務地(住所)
神奈川県
勤務時間
9:30〜18:30
交通
小田急線 本厚木駅 下車徒歩15分
給与・年収
550万円〜650万円
モデル年収
※経験・能力を考慮し、当社規定により優遇。前職年収を考慮致します。
・別途、残業代全額支給
・昇給/年1回
・賞与/年2回
・決算賞与/年1回
・試用期間3ケ月間
・別途、残業代全額支給
・昇給/年1回
・賞与/年2回
・決算賞与/年1回
・試用期間3ケ月間
待遇・福利厚生
・健康保険
・雇用保険
・労災保険
・厚生年金
・退職金制度
・雇用保険
・労災保険
・厚生年金
・退職金制度
休日・休暇
・完全週休2日制(土・日)祝・祭日
・夏季休暇
・年末年始休暇
・年次有給休暇(初年度 10日間、最高20日間)
・年間休日(126日)
・夏季休暇
・年末年始休暇
・年次有給休暇(初年度 10日間、最高20日間)
・年間休日(126日)
企業の特徴
上場を目指す
求人更新日
2023年7月3日
企業情報
会社名
株式会社ヘルツテック
本社所在地
東京都新宿区西新宿7-5-12 岡田ビル3F
設立日
2012年03月
資本金
1000万円
代表者
代表取締役 鶴薗 英久
従業員数
50人
平均年齢
組込み系ソフトウエア開発エンジニア※東京近郊
URL
https://www.green-japan.com/company/3707
業種
IT/Web・通信・インターネット系
事業内容
電子機器、通信機器、精密機器、モバイル開発、カーエレクトロニクス等の設計開発。
組込製品ソフトウェア設計開発。
集積回路のデジタル、アナログICのハードウェア設計開発。
ハードウェアおよびソフトウェアの設計開発の人材派遣業(般13-305622)
組込製品ソフトウェア設計開発。
集積回路のデジタル、アナログICのハードウェア設計開発。
ハードウェアおよびソフトウェアの設計開発の人材派遣業(般13-305622)
応募方法
選考プロセス
▼書類選考
▼面接複数回(現場マネジャー、役員)
▼内定
※上記は変更になる場合がございます。
▼面接複数回(現場マネジャー、役員)
▼内定
※上記は変更になる場合がございます。
採用人数
5
応募資格
【必須要件】
・ASIC又はFPGAの回路論理設計経験者。
・Verilog HDL 又は VHDLのどちらかの記述言語の経験者。
【求める人物像】
・ものづくりが好きで、スキルを追究したい方
・「こういうものをつくっていきたい」という思いのある方
・向上心のある方
・積極的に仕事に取り組みやる気がある方
・ASIC又はFPGAの回路論理設計経験者。
・Verilog HDL 又は VHDLのどちらかの記述言語の経験者。
【求める人物像】
・ものづくりが好きで、スキルを追究したい方
・「こういうものをつくっていきたい」という思いのある方
・向上心のある方
・積極的に仕事に取り組みやる気がある方
必読
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